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參數資料
| 型號： | 97042-99 |
| 廠商： | PEREGRINE SEMICONDUCTOR CORP |
| 元件分類： | PLL合成/DDS/VCOs |
| 英文描述： | PHASE LOCKED LOOP, 300 MHz, UUC |
| 封裝： | DIE |
| 文件頁數： | 9/11頁 |
| 文件大小： | 456K |
| 代理商： | 97042-99 |
Product Specification
PE97042
Page 7 of 11
Document No. 70-0236-05
│ www.psemi.com
2007-2011 Peregrine Semiconductor Corp. All rights reserved.
R
C
L
R
n
Rp
C
L
PD_D & PD_U
Vdd
or
n = 50
R
p = 50
Figure 6. Equivalent Input Diagram: Reference Input
Figure 7. Equivalent Input Diagram: Main Input
Figure 8. Equivalent Output Diagram: PD_
D & PD_U Outputs
Rf
Fref
Rf = 112k
C
eq = 12pF
C
eq
R
f
Pin 42
Peregrine Specification 71/0032
Peregrine Specification 71/0033
Peregrine Specification 71/0034
Pin 27
Pin 28
C
eq
R
f
in
Rf
Rf = 50k
C
eq = 0.8pF
L
bw = 3nH
Lbw
Rf = 50k
C
eq = 0.8pF
L
bw = 3nH
Lbw
C
eq
R
f
Lbw
F
Fin
F
Fin
3nH
Lbw
Pin 36
Pin 37
Rf = 112 k
Ceq = 12 pF
Rf = 50 k
Ceq = 0.8 pF
Lbw = 3 nH
Rn = 50
Rp = 50
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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