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參數資料
| 型號： | C8051F060 |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數： | 231/328頁 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 64K FLASH 100TQFP |
| 標準包裝： | 90 |
| 系列： | C8051F06x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 25MHz |
| 連通性： | CAN，EBI/EMI，SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數： | 59 |
| 程序存儲器容量： | 64KB（64K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 4.25K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數據轉換器： | A/D 2x16b，8x10b; D/A 2x12b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 包裝： | 托盤 |
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C8051F060/1/2/3/4/5/6/7
306
Rev. 1.2
25.2.1. Edge-triggered Capture Mode
In this mode, a valid transition on the CEXn pin causes PCA0 to capture the value of the PCA0 counter/
timer and load it into the corresponding module's 16-bit capture/compare register (PCA0CPLn and
PCA0CPHn). The CAPPn and CAPNn bits in the PCA0CPMn register are used to select the type of transi-
tion that triggers the capture: low-to-high transition (positive edge), high-to-low transition (negative edge),
or either transition (positive or negative edge). When a capture occurs, the Capture/Compare Flag (CCFn)
in PCA0CN is set to logic 1 and an interrupt request is generated if CCF interrupts are enabled. The CCFn
bit is not automatically cleared by hardware when the CPU vectors to the interrupt service routine, and
must be cleared by software.
Note: The signal at CEXn must be high or low for at least 2 system clock cycles in order to be valid.
Figure 25.4. PCA Capture Mode Diagram
PCA0L
PCA0CPLn
PCA
Timebase
CEXn
Crossbar
Port I/O
PCA0H
Capture
PCA0CPHn
0
1
0
1
(t
o
CCFn)
PCA Interrupt
PCA0CPMn
P
W
M
1
6
n
E
C
O
M
n
E
C
F
n
T
O
G
n
P
W
M
n
C
A
P
n
C
A
P
N
n
M
A
T
n
PCA0CN
C
F
C
R
C
F
0
C
F
2
C
F
1
C
F
5
C
F
4
C
F
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