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參數資料
| 型號： | MC68HC12D60 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Advance Information - Rev 4.0 |
| 中文描述： | 推進信息-活4.0 |
| 文件頁數： | 168/432頁 |
| 文件大小： | 2994K |
| 代理商： | MC68HC12D60 |
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Clock Functions
Advance Information
68HC(9)12D60 — Rev 4.0
168
Clock Functions
MOTOROLA
SYSCLK = (BCSP & PLLCLK) | (BCSP & BCSS & EXTALi) | (BCSP &
BCSS & SLWCLK)
MCLK = (PCLK & MCS) | (XCLK & MCS)
MSCAN system = (EXTALi & CLKSRC) | (SYSCLK & CLKSRC)
BDM system = (BCLK & CLKSW) | (ECLK & CLKSW)
NOTE:
During limp-home mode PCLK, ECLK, BCLK, MCLK and XCLK are
supplied by VCO (PLLCLK).
12.8 Clock Divider Chains
Figure 12-6
,
Figure 12-7
,
Figure 12-8
, and
Figure 12-9
summarize the
clock divider chains for the various peripherals on the 68HC(9)12D60.
F
Freescale Semiconductor, Inc.
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n
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