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參數資料
| 型號： | AD8325-EVAL |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 5 V CATV Line Driver Fine Step Output Power Control |
| 中文描述： | 5伏精細有線電視線路驅動器輸出功率控制步 |
| 文件頁數： | 3/16頁 |
| 文件大小： | 304K |
| 代理商： | AD8325-EVAL |
REV. 0
AD8325
–3–
LOGIC INPUTS (TTL/CMOS-Compatible Logic)
Parameter
Min
Typ
Max
Unit
Logic “1” Voltage
Logic “0” Voltage
Logic “1” Current (V
INH
= 5 V) CLK, SDATA,
DATEN
Logic “0” Current (V
INL
= 0 V) CLK, SDATA,
DATEN
Logic “1” Current (V
INH
= 5 V) TXEN
Logic “0” Current (V
INL
= 0 V) TXEN
Logic “1” Current (V
INH
= 5 V)
SLEEP
Logic “0” Current (V
INL
= 0 V)
SLEEP
TIMING REQUIREMENTS
2.1
0
0
–600
50
–250
50
–250
5.0
0.8
20
–100
190
–30
190
–30
V
V
nA
nA
μ
A
μ
A
μ
A
μ
A
Parameter
Min
Typ
Max
Unit
Clock Pulsewidth (T
WH
)
Clock Period (T
C
)
Setup Time SDATA vs. Clock (T
DS
)
Setup Time
DATEN
vs. Clock (T
ES
)
Hold Time SDATA vs. Clock (T
DH
)
Hold Time
DATEN
vs. Clock (T
EH
)
Input Rise and Fall Times, SDATA,
DATEN
, Clock (T
R
, T
F
)
16.0
32.0
5.0
15.0
5.0
3.0
ns
ns
ns
ns
ns
ns
ns
10
(Full Temperature Range, V
CC
= 5 V, T
R
= T
F
= 4 ns, f
CLK
= 8 MHz unless otherwise noted.)
(
DATEN
, CLK, SDATA, TXEN,
SLEEP
, V
CC
= 5 V: Full Temperature Range)
T
ES
VALIMSB. . . .LSB
GAIN TRANSFER (G1)
T
DS
T
EH
8 CLOCK
CYCLES
GAIN TRANSFER (G2)
T
OFF
T
GS
ANALOG
OUTPUT
SIGNAL AMPLITUDE (p-p)
TXEN
CLK
SDATA
DATEN
T
ON
T
C
T
WH
VALID DATA WORD G2
Figure 2. Serial Interface Timing
VALID DATA BIT
MSB
MSB-1
MSB-2
T
DS
T
DH
SDATA
CLK
Figure 3. SDATA Timing
相關PDF資料 |
PDF描述 |
|---|---|
| AD8325 | Fast Switching Digitally Controlled Variable Gain Amplifier(快速轉換數字控制的可變增益放大器) |
| AD8326ARE-EVAL | ER 4C 4#0 PIN RECP |
| AD8326ARE-REEL | High Output Power Programmable CATV Line Driver |
| AD8326ARP-EVAL | High Output Power Programmable CATV Line Driver |
| AD8326ARP-REEL | High Output Power Programmable CATV Line Driver |
相關代理商/技術參數 |
參數描述 |
|---|---|
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