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參數資料
| 型號： | W93910 |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 尋呼電路 |
| 英文描述： | ERMES(Enhanced Radio Emessage System) Paging Protcol Decoder(增強的無線電子信息系統(tǒng)尋呼解碼器) |
| 中文描述： | TELECOM, PAGING DECODER, PDSO28 |
| 封裝： | SSOP-28 |
| 文件頁數： | 21/35頁 |
| 文件大小： | 267K |
| 代理商： | W93910 |
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W93910
Publication Release Date: Auguest 1999
- 21 - Revision A1
Table 16
Table 19 list the active level and timing option bit settings of the data output format. MCLK
clock rate is defined by option bit MCK1
0. The duration between each word, Tint, and the duration
between each byte, Tudi, are defined by option bit UDI1
UDI0. Option bit MCKEG defines MCLK active
edge. MCKI, MSGI and MDAI option bits set MCLK, MSGVAL and MDATA pin initial and active state.
The output sequence of MDATA pin is SIW, CMW, MDW0, MDW1...MDWn, EDW for all the message
types except long message. For long message, an extra AIW is added between CMW and MDW0.
Please refer to
Summary of Data Output Format
for different paging message format.
OPTION BIT
FUNCTION
MCKEG
MCLK active edge
0
Falling edge active
1
Rising edge active
Table 16. Data output pin option
OPTION BIT
FUNCTION
MSGI
MSGVAL active level
0
active low
1
active high
Table 17. Data output pin option
OPTION BIT
FUNCTION
MDAI, MCKI
MDATA, MCKI pin initial state
0
Initial low
1
Initial high
Table 18. Data output pin option
相關PDF資料 |
PDF描述 |
|---|---|
| W942508CH | 8M x 4 BANKS x 8 BIT DDR SDRAM |
| W942508CH-5 | 8M x 4 BANKS x 8 BIT DDR SDRAM |
| W942508CH-6 | 8M x 4 BANKS x 8 BIT DDR SDRAM |
| W942508CH-7 | 8M x 4 BANKS x 8 BIT DDR SDRAM |
| W942508CH-75 | 8M x 4 BANKS x 8 BIT DDR SDRAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| W9393 | 制造商:Winslow Adaptics Ltd 功能描述:28/32 way DIL-PLCC plug conversion,W9393 |
| W9395 | 制造商:Winslow Adaptics Ltd 功能描述:40/44 way DIL-PLCC plug conversion,W9395 |
| W93-A112-50 | 制造商:TE Connectivity 功能描述: |
| W93A8AD/SYC/H | 制造商:Kingbright Corporation 功能描述: |
| W93A8EWP/GDTG0L | 制造商:Kingbright Corporation 功能描述:LED Uni-Color Green 565nm 2-Pin SMD |
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