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參數資料
| 型號： | W81C280 |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | USB Keyboard/ Device Controller(具有通用串行總線接口的鍵盤／設備控制器) |
| 中文描述： | 8-BIT, MROM, MICROCONTROLLER, PDIP40 |
| 封裝： | DIP-40 |
| 文件頁數： | 17/27頁 |
| 文件大小： | 328K |
| 代理商： | W81C280 |
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W81C280
Publication Release Date: July 1997
- 13 -
Revision 0.50
Reading the Control transfer's Setup stage (always 8 bytes of data sent from the host):
ST
11101001
AW
SR0 (8)
AU
SR1 (8)
AU
SR2 (8)
AU
SR3 (8)
AU
SETUP PID AU ADDRESS AU
CRC
AU DATA0 PID AU
DATA0
AU
DATA1
AU
DATA2
AU
DATA3
AU
DATA4
AU
DATA5
AU
DATA6
AU
DATA7
AU
CRC
AU
CRC
NA SP
11101001= the serial bus
s
Read Address
Reading the Control transfer's Data stage for a Write transfer (maximum 8 bytes of data sent from
the host):
ST
11101001 AW
SR0 (8)
AU
SR1 (8)
OUT PID
AU ADDRESS AU
DATA0
AU
DATA1
AU
DATA2
DATA5
AU
DATA6
AU
DATA7
AU
SR2 (8)
CRC
DATA3
CRC
AU
AU DATA1 PID AU
AU
DATA4
AU
CRC
SR3 (8)
AU
AU
AU
AU
NA SP
Reading the Control transfer's Status stage for a Read / Write transfer:
ST
11101001 AW
SR0 (8)
AU
IN PID
AU ADDRESS AU
SR1 (8)
AU
SR2 (8)
CRC
AU
AU ACK or FFh NA SP
SR3 (8)
AU
An ACK is read when the host successfully received the data packet sent from the W81C280.
Then the handshake was completed.
If the BAD_RECV bit in StatusRegister0 is set and CRC_OFF bit is cleared in ControlRegister 2, then
ignore all data read.
6.3.2 Reading ACK Flag for the USB's Endpoint 1 - 4
The endpoint 1 - 4 are used for the Interrupt transfers. After valid datas (
I
N
DATA stage) are sent
to the host via USB's endpoint 1 - 4 FIFOs, and then ACK is sent by host, The interrupt flag is
enabled and EP1_ACK/EP2_ACK/EP3_ACK/EP4_ACK is set in Status Registers. Therefore, the
CPU core check the ACK handshake just from Status Registers.
Checking the Interrupt transfer's Handshake from host:
ST
11101001 AW
SR0 (8)
AU
SR1 (8)
AU
SR2 (8)
AU
SR3 (8)
AU SP
11101001= the serial bus Read Address
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