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參數(shù)資料
| 型號： | W83977AF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PLUG & PLAY 1.0A COMPLIANT |
| 中文描述： | 插頭 |
| 文件頁數(shù)： | 54/181頁 |
| 文件大小： | 2600K |
| 代理商： | W83977AF |
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W83977F/ W83977AF
PRELIMINARY
Publication Release Date: January 1997
-
43
-
Revision 0.50
3.
UART PORT
3.1
Universal Asynchronous Receiver/Transmitter (UART A, UART B)
The UARTs are used to convert parallel data into serial format on the transmit side and convert serial
data to parallel format on the receiver side. The serial format, in order of transmission and reception,
is a start bit, followed by five to eight data bits, a parity bit (if programmed) and one, one and half
(five-bit format only) or two stop bits. The UARTs are capable of handling divisors of 1 to 65535 and
producing a 16x clock for driving the internal transmitter logic. Provisions are also included to use
this 16x clock to drive the receiver logic. The UARTs also support the MIDI data rate. Furthermore,
the UARTs also include complete modem control capability and a processor interrupt system that
may be software trailed to the computing time required to handle the communication link. The
UARTs have a FIFO mode to reduce the number of interrupts presented to the CPU. In each UART,
there are 16-byte FIFOs for both receive and transmit mode.
3.2
Register Address
3.2.1
The UART
Control Register controls and defines the protocol for asynchronous data communications,
including data length, stop bit, parity, and baud rate selection.
UART Control Register (UCR) (Read/Write)
1
2
3
4
5
6
7
0
Data length select bit 0 (DLS0)
Data length select bit 1(DLS1)
Multiple stop bits enable (MSBE)
Parity bit enable (PBE)
Even parity enable (EPE)
Parity bit fixed enable (PBFE)
Set silence enable (SSE)
Baudrate divisor latch access bit (BDLAB)
Bit 7: BDLAB. When this bit is set to a logical 1, designers can access the divisor (in 16-bit binary
format) from the divisor latches of the baudrate generator during a read or write operation.
When this bit is reset, the Receiver Buffer Register, the Transmitter Buffer Register, or the
Interrupt Control Register can be accessed.
Bit 6: SSE. A logical 1 forces the Serial Output (SOUT) to a silent state (a logical 0). Only IRTX is
affected by this bit; the transmitter is not affected.
Bit 5: PBFE. When PBE and PBFE of UCR are both set to a logical 1,
(1) if EPE is logical 1, the parity bit is fixed as logical 0 to transmit and check.
(2) if EPE is logical 0, the parity bit is fixed as logical 1 to transmit and check.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| W83977EF | WINBOND I/O |
| W83977F | PLUG & PLAY 1.0A COMPLIANT |
| W83977TF-AW | I/O chip disk drive adapter |
| W83977TF-P | I/O chip disk drive adapter |
| W83977TF-PW | I/O chip disk drive adapter |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| W83977AF-A | 制造商:WINBOND 制造商全稱:Winbond 功能描述:WINBOND I/O |
| W83977AF-P | 制造商:WINBOND 制造商全稱:Winbond 功能描述:WINBOND I/O |
| W83977AG-A | 功能描述:IC I/O CONTROLLER 128-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:- 標(biāo)準(zhǔn)包裝:3,000 系列:- 應(yīng)用:PDA，便攜式音頻/視頻，智能電話 接口:I²C，2 線串口 電源電壓:1.65 V ~ 3.6 V 封裝/外殼:24-WQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:24-QFN 裸露焊盤（4x4） 包裝:帶卷 (TR) 安裝類型:表面貼裝 產(chǎn)品目錄頁面:1015 (CN2011-ZH PDF) 其它名稱:296-25223-2 |
| W83977ATF | 制造商:WINBOND 制造商全稱:Winbond 功能描述:WINBOND I/O |
| W83977ATF-AW | 制造商:Winbond Electronics Corp 功能描述: |
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