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參數資料
| 型號： | W88227F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-ROM Decoder(支持ATAPI標準的CD-ROM解碼器) |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP128 |
| 封裝： | PLASTIC, QFP-128 |
| 文件頁數： | 94/116頁 |
| 文件大小： | 787K |
| 代理商： | W88227F |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁當前第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁
Preliminary/Confidential
Subject to change without notice
W88227F/W88227QD
- 90 -
1999/10/1 Rev: 0.70
Bit 5:
BLIMEN - Buffer Limit Enable
If
BLIMEN (9Ah.5)
is high, the buffering of DSP data stops when the condition defined by
BLIMS
(9Ah.4)
is met. This function should be enabled if
BICEN (9Ah.7)
is set high.
BLIMS - Buffer Limit Source Select
Bit 4:
If
BLIMS (9Ah.4)
is high, the buffering stop when
BUFC (9Bh,r)
reach
BUFLIM (9Bh,w)
. If
BLIMS
(9Ah.4)
is low, the buffering stops when
buffering block (internal) reach
TBH/L (24h/25h,r)
minus 1.
Bit 3-0: RCLIM[3:0] - Repeat Correction Limit
If
BICEN (9Ah.7)
is high, these four bits specify the maximum number of repeat correction.
BUFLIM - Buffer Limit Register - (write 9Bh)
This register is used as buffer limit when
BLIMS (9Ah.4)
is high. This register can be set the buffer-ring size
minus
n
, where
n
is larger than 1. This register is 0 after master reset and firmware reset. In normal
operation, this register only needs to be set once after power-on.
BUFC - Buffer Counter - (read 9Bh)
This counter increments when a sector is buffered into external RAM. If
ACMEN (9Ch.6)
is high,
BUFC
(9Bh,r)
decrements at the end of each data-in block transfer unless the value is zero. The value follows 0 is 0.
The transfer of working area data should be implemented as linear transfer to prevent extra decrement of this
counter.
If
ACMEN (9Ch.6)
is high,
BUFC (9Bh,r)
minus
N
right after
SKIPC (9Eh)
is set
N
. This function can be used
to implement the cache-partial-hit event.
If both
BLIMEN (9Ah.5)
and
BLIMS (9Ah.4)
is high, the buffering stop when this count reaches
BUFLIM
(9Bh,w)
. The value in BUFC (9Bh,r) may exceed
BUFLIM (9Bh,w)
by one.
This counter is synchronized to
TCC (9Dh)
whenever
DECEN (0Ah.w7)
is low.
This counter is 0 after master reset and firmware reset.
ACCTL - Automatic Cache Control Register - (read/write 9Ch)
This register is 0 after chip reset, host reset and firmware reset.
Bit 7: ATTEN - Automatic Transfer Trigger Enable
The control bit
ADTT (17h.w2)
is automatically set high if all the following conditions are met:
ATTEN (9Ch.7)
is high
TCC (9Dh)
is not zero
TTC (9Fh)
is not zero
相關PDF資料 |
PDF描述 |
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