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參數資料
| 型號： | W83877TF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | Multi-Function I/O Port Controller(用于個人計算機的多功能輸入/輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數： | 130/154頁 |
| 文件大小： | 821K |
| 代理商： | W83877TF |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁當前第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁
W83877TF
Publication Release Date: March 1998
- 104 -
Version 0.61
GPEAD7 - GPEAD1 (Bit7 - bit 1): Base address of the power management register block GPE.
This address is the base address of GPE0_BLK in the ACPI specification. The based address should
range from 01,0000,0000
b
to 11,1111,1000
b
,i.e., 100H ~ 3F8H, where bit 0 of the base address
should be set to 0 and the based address is in the 8-byte alignment. Note that the base address of
GPE1_BLK is GPE0_BLK + 4.
Bit 0: Reserved, fixed at 0.
8.2.40 Configuration Register 35 (CR35), default=00H
When the device is in Extended Function mode and EFIR is 35H, the CR35 register can be accessed
through EFDR. The bit definitions are as follows:
1
2
3
4
5
6
7
0
URACNT0
URACNT1
URACNT2
URACNT3
URACNT4
URACNT5
URACNT6
URACNT7
URACNT7 - URACNT0 (Bit 7 - bit 0): UART A idle timer count.
This register is used to specify the initial value of UART A idle timer. Once UART A enters the
working state (that is, after any access to this device, any IRQ, and any external input), the power
down machine of UART A reloads this count value and the idle timer counts down. When the timer
counts down to zero, UART A enters the power down state ,i.e., sleeping state. If this register is set to
00H, the power down function will be invalid. The time resolution of this value is minute or second,
which is defined by the TMIN_SEL bit of the CR3A. Note that (1). this register is valid only when the
power management function of UART A is enabled, that is, CHIPPME=1 (CR32 bit 7) and
URAPME=1 (CR32 bit 1), (2). If the register is set to 00H, UART A will remain in the current
state(working or sleeping).
8.2.41 Configuration Register 36 (CR36), default=00H
When the device is in Extended Function mode and EFIR is 36H, the CR36 register can be accessed
through EFDR. The bit definitions are as follows:
1
2
3
4
5
6
7
0
URBCNT0
URBCNT1
URBCNT2
URBCNT3
URBCNT4
URBCNT5
URBCNT6
URBCNT7
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PDF描述 |
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參數描述 |
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