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參數資料
| 型號： | W83877TF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | Multi-Function I/O Port Controller(用于個人計算機的多功能輸入/輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數： | 131/154頁 |
| 文件大小： | 821K |
| 代理商： | W83877TF |
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W83877TF
Publication Release Date: March 1998
- 105 -
Version 0.61
URBCNT7 - URBCNT0 (Bit 7 - bit 0): UART B idle timer count.
This register is used to specify the initial value of UART B idle timer. Once UART B enters the
working state (that is, after any access to this device, any IRQ, and any external input), the power
down machine of UART B reloads this count value and the idle timer counts down. When the timer
counts down to zero, UART B enters the power down state ,i.e., sleeping state. If this register is set to
00H, the power down function will be invalid. The time resolution of this value is minute or second,
which is defined by the TMIN_SEL bit of CR3A. Note that (1). this register is valid only when the
power management function of UART B is enabled, that is, CHIPPME=1 (CR32 bit 7) and
URBPME=1 (CR32 bit 0), (2). If the register is set to 00H, UART B will remain in the current
state(working or sleeping).
8.2.42 Configuration Register 37 (CR37), default=00H
When the device is in Extended Function mode and EFIR is 37H, the CR37 register can be accessed
through EFDR. The bit definitions are as follows:
1
2
3
4
5
6
7
0
FDCCNT0
FDCCNT1
FDCCNT2
FDCCNT3
FDCCNT4
FDCCNT5
FDCCNT6
FDCCNT7
FDCCNT7 - FDCCNT0 (Bit 7 - bit 0): FDC idle timer count.
This register is used to specify the initial value of FDC idle timer. Once FDC enters the working state
(that is, after any access to this device, any IRQ, and any external input), the power down machine of
FDC reloads this count value and the idle timer counts down. When the timer counts down to zero,
FDC enters the power down state ,i.e., sleeping state. If this register is set to 00H, the power down
function will be invalid. The time resolution of this value is minute or second, which is defined by the
TMIN_SEL bit of the CR3A. Note that (1). this register is valid only when the power management
function of FDC is enabled, that is, CHIPPME=1 (CR32 bit 7) and FDCPME=1 (CR32 bit 2), (2). If the
register is set to 00H, FDC will remain in the current state(working or sleeping).
相關PDF資料 |
PDF描述 |
|---|---|
| W83971D | AC97 AUDIO CODEC |
| W83977AF | PLUG & PLAY 1.0A COMPLIANT |
| W83977EF | WINBOND I/O |
| W83977F | PLUG & PLAY 1.0A COMPLIANT |
| W83977TF-AW | I/O chip disk drive adapter |
相關代理商/技術參數 |
參數描述 |
|---|---|
| W83877TG | 功能描述:IC I/O CONTROLLER 100-PQFP RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:- 標準包裝:3,000 系列:- 應用:PDA，便攜式音頻/視頻，智能電話 接口:I²C，2 線串口 電源電壓:1.65 V ~ 3.6 V 封裝/外殼:24-WQFN 裸露焊盤 供應商設備封裝:24-QFN 裸露焊盤（4x4） 包裝:帶卷 (TR) 安裝類型:表面貼裝 產品目錄頁面:1015 (CN2011-ZH PDF) 其它名稱:296-25223-2 |
| W83910F | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:IPMI BMC plus H/W Monitor. UART. 5-sets Master/Slave SMBus. for Server PC Application |
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