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參數(shù)資料
| 型號： | W9961CF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 消費家電 |
| 英文描述： | H.263/H.261 Video Codec |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP208 |
| 封裝： | 28 X 28 MM, 2.60 MM HEIGHT, PLASTIC, QFP-208 |
| 文件頁數(shù)： | 38/65頁 |
| 文件大小： | 344K |
| 代理商： | W9961CF |
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W9961CF
- 38 -
20
16
15
0
DMSA[4:0]
16-bit DM address indicated by the load or store instruction
7.4.3 RISC Registers
The internal RISC provides the following registers:
32 16-bit general purpose registers
2 registers that hold the results of integer multiply and add (MULA) and divide (DIV)
operations
4 shadow registers that store current status at IF stage (PC0), DEC stage (IR0_L and
IR0_H), and EXE stage (MPZ0) during a CALL procedure or an interrupt service.
7.4.3.1 General Registers
The 32 general purpose registers provide general resources for all computation. Figure 7.9 shows the
32 general registers (R0 ~ R31). R0 has assigned functions: when R0 is used as a source operand, it
provides zero value, when R0 is used as the destination register, the result is discarded.
R0
R1
R2
R0
R30
R31
.
15
0
.
.
Figure 7.9 RISC General Registers
7.4.3.2 Shadow Registers
There are four shadow registers, PC0, IR0_L, IR0_H, and MPZ0, which store current status at
pipeline stages to eliminate the state save and restore time in a CALL subroutine or an interrupt
service. The behavior of the shadow registers is described below.
Before entering CALL subroutine or interrupt service: current status at IF/DEC/EXE pipeline stages
are stored into shadow registers in one cycle.
When executing RET instruction: contents of shadow registers are restored at IF/DEC/EXE pipeline
stages
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