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參數資料
| 型號： | W946432AD |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | 512K X 4 BANKS X 32 BITS DDR SDRAM |
| 中文描述： | 為512k × 4銀行× 32位DDR內存 |
| 文件頁數： | 7/40頁 |
| 文件大小： | 462K |
| 代理商： | W946432AD |
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W946432AD
512K
×
4 BANKS
×
32 BITS DDR SDRAM
PRELIMINARY DATA:9/8/00
7
AC CHARACTERISTICS
(0°C
≤
TA
≤
70°C; V
DD
Q = +2.5V ± 0.2V, V
DD
= +2.5V ± 0.2V)
PARAMETER
tAC
-4
-5
-6
UNIT
NOTE
MIN. MAX. MIN. MAX. MIN. MAX.
-0.1
0.1
-0.1
DQ output access time from CLK/ CLK
0.1
-0.1
0.1
tCK
DQS output access time from CLK/ CLK
CLK high-level width
CLK low-level width
Clock cycle time
DQ and DM input hold time
DQ and DM input setup time
DQ and DM input pulse width (for each input)
Data-out high-impedance time from CLK/ CLK
tDQSCK
-0.1
0.45
0.45
4
0.5
0.5
1
-0.1
0.1
0.55
0.55
8
0.1
-0.1
0.45
0.45
5
0.5
0.5
1.6
0.1
0.55
0.55
8
-0.1
0.45
0.45
6
0.5
0.5
1.6
0.1
0.55
0.55
8
tCK
tCH
tCL
tCLK
tDH
tDS
tDIPW
tHZ
tCK
tCK
ns
ns
ns
ns
tCK
8
Data-out low-impedance time from CLK/ CLK
DQS-DQ Skew (for DQS and associated DQ
signals)
DQS-DQ Skew (for DQS and all DQ signals)
DQ/DQS output valid time
Write command to first DQS latching transition
DQS input high pulse width
DQS input low pulse width
DQS falling edge to CLK setup time
DQS falling edge hold time from CLK
MODE REGISTER SET command cycle time
Write postamble
Write preamble
Address and Control input hold time
Address and Control input setup time
Read preamble
Read postamble
ACTIVE to PRECHARGE command
ACTIVE to ACTIVE/Auto Refresh command period
Auto Refresh to Active/Auto Refresh command
period
ACTIVE to READ or WRITE delay
PRECHARGE command period
ACTIVE bank A to ACTIVE bank B command
Write recovery time
Auto Precharge write recovery + precharge time
Internal Write to Read Command Delay
Exit SELF REFRESH to non-READ command
Exit SELF REFRESH to READ command
Average Periodic Refresh Interval
tLZ
-0.1
0.1
tCK
tDQSQ
-0.5
0.5
-0.5
0.5
-0.5
0.5
ns
tDQSQA
tDV
tDQSS
tDQSH
tDQSL
tDSS
tDSH
tMRD
tWPST
tWPRE
TIH
TIS
tRPRE
tRPST
tRAS
tRC
tRFC
-0.5
0.35
0.75
0.35
0.35
0.2
0.2
2
0.4
0.25
1
1
0.9
0.4
35
47
0.5
1.25
0.6
1.1
0.6
ns
tCK
tCK
tCK
tCK
tCK
tCK
tCK
tCK
tCK
ns
ns
tCK
tCK
0.35
0.75
0.4
0.4
0.9
35
55
0.35
0.75
0.4
0.4
0.9
42
60
1.25
0.6
0.6
1.1
120K
1.25
0.6
0.6
1.1
120K ns
ns
ns
47
66
72
tRCD
tRP
tRRD
tWR
tDAL
tWTR
tXSNR
tXSRD
tREFI
3
3
2
2
5
2
47
200
15
15
11
10
25
200
18
18
12
12
30
200
tCK
tCK
tCK
tCK
tCK
tCK
ns
tCK
us
9
15.6
15.6
15.6
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PDF描述 |
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