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參數資料
| 型號： | 28229-14 |
| 廠商： | MINDSPEED TECHNOLOGIES INC |
| 元件分類： | 數字傳輸電路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數： | 203/269頁 |
| 文件大小： | 3376K |
| 代理商： | 28229-14 |
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28229-DSH-001-B
Mindspeed Technologies
2
-11
CX28224/5/9 Data Sheet
CX2822x Hardware Description
PH
Y
Si
de
In
te
rf
ac
e
(
C
o
n
ti
nu
ed
)
phyURxData[0]
PHY UTOPIA Receive
Data
P9
I
Received 8 bit PHY Cell Data. All received cells are passed
to the internal IMA processor.
phyURxData[1]
T9
I
phyURxData[2]
R9
I
phyURxData[3]
P10
I
phyURxData[4]
T12
I
phyURxData[5]
R12
I
phyURxData[6]
P13
I
phyURxData[7]
N13
I
phyURxSOC
PHY UTOPIA Start of
Cell
N14
I
Start of Cell synchronization signal for Receive PHY cells
(active high). Indicates that the first byte of the cell is being
placed on the PhyURxData[7:0] bus.
phyUTxAddr[0]
PHY UTOPIA
Transmit Address
T14
O
Transmit PHY Cell Bus address. The following limitations
apply:
phyUTxAddr[1]
T13
phyUTxAddr[2]
R13
phyUTxAddr[3]
L15
phyUTxAddr[4]
K13
phyUTxClAv[0]
PHY UTOPIA
Transmit Cell
Available
R14
I
Cell Available signals for Transmit ATM cells. When
phyUTxClAv[n] is active high, the PHY has space available
for one or more complete cells. To support different PHY
devices, separate cell available signals are provided.
PhyUTxClAv[1] is a No Connect on the CX28224/5 devices.
phyUTxClAv[1]
R15
I/PD
phyUTxClk
PHY UTOPIA
Transmit Clock
T15
O
IMA_SysClk divided by two.
phyUTxData[0]
PHY UTOPIA
Transmit Data
R16
O
8 bit PHY Cell Data to be sent out the PHY facility.
8 bit UTOPIA interface used to transmit data to the external
TC devices.
phyUTxData[1]
P15
O
phyUTxData[2]
M13
O
phyUTxData[3]
N15
O
phyUTxData[4]
P16
O
phyUTxData[5]
N16
O
phyUTxData[6]
M14
O
phyUTxData[7]
L13
O
phyUTxEnb[0]*
PHY UTOPIA
Transmit Enable
M15
O
Data transfer enable for Transmit PHY cells (active low
signal). To support different PHY devices, separate enable
signals are provided.
phyUTxEnb[1]*
C14
phyUTxSOC
PHY UTOPIA
Transmit Start of Cell
E16
O
Start of Cell synchronization signal for Transmit PHY cells
(active high). Indicates that the first byte of a cell is being
placed on the phyUTxData[7:0] bus.
Table 2-3. CX2822x Pin Descriptions (6 of 12)
Pin Label
Signal Name
No.
I/O
Description
Device
Addresses
CX28224
0, 1, 31
CX28225
0–3, 31
CX28229
0–31
相關PDF資料 |
PDF描述 |
|---|---|
| 28230-13 | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208 |
| 28L0138-40R | 1 FUNCTIONS, FERRITE BEAD |
| 28L0138-70R | 1 FUNCTIONS, FERRITE BEAD |
| 28Z551 | TELECOM FILTER |
| 28Z550 | TELECOM FILTER |
相關代理商/技術參數 |
參數描述 |
|---|---|
| 28-22916 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 15S-60MIN |
| 28-22918 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 0.1-10 SEC |
| 28-22920 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 1-99 SEC |
| 28-22922 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD SEQUENTIAL TIMER 1SEC-3MIN |
| 28-22926 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD ON DELAY TIMER 1-60 SECOND |
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