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參數資料
| 型號： | 28229-14 |
| 廠商： | MINDSPEED TECHNOLOGIES INC |
| 元件分類： | 數字傳輸電路 |
| 英文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA256 |
| 封裝： | BGA-256 |
| 文件頁數： | 73/269頁 |
| 文件大?。?/td> | 3376K |
| 代理商： | 28229-14 |
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7-64
Mindspeed Technologies
28229-DSH-001-B
Registers
CX28224/5/9 Data Sheet
0x200—MODE (Device Mode Control Register)
Bit
Default
Name
Description
7
0
DevMstRst
Device master reset. When set high, all internal state machines in the TC block are
held in reset and all registers (except this bit) assume their default values.
6
0
DevLgcRst
Device logic reset. When set high, all internal state machines in the TC block are
held in reset but register values are unaffected.
5
0
EnStatLat
When set to 1, the one-second status latching is enabled. The value of the status
bits are the events which occurred between the last two one-second events. Any
events occurring after the last one-second event is not reflected when the status
register is read. Those events are reflected in the status register upon the next one-
second event. When a status register is read, the status is cleared and is not
updated until the next one-second event.
When set to 0, the one-second status latching is disabled. The value of a status
register is the events occurred since the last read of the status register.
4
0
EnCntrLat
When set to 1, the one-second counter latching is enabled. The value of the
counter is the number of events counted between the last two one-second events.
Any events occurring after the last one-second event is not reflected when the
counter is read. Those events are reflected in the counter upon the next one-
second event. When a counter is read, the count is cleared and is not updated until
the next one-second event.
When set to 0, the one-second counter latching is disabled. The value of a counter
is the number of events counted since the last read of the counter.
3
0
EnIntPin
Enables the MicroInt* output pin.
2–100
—
Reserved, set to zero.
0
OneSecOut
When set to 1, the OneSecIO pin is configured as an output. The pin provides a
one-second event pulse. The one-second event is generated internally of the
device. The event occurs after the device has counted 8000 periods of a 8 KHz
clock.
When set to 0, the OneSecIO pin is configured as an input. The one-second event
must be genetared externally, by pulsing the OneSecIO pin for low-high-low.
相關PDF資料 |
PDF描述 |
|---|---|
| 28230-13 | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP208 |
| 28L0138-40R | 1 FUNCTIONS, FERRITE BEAD |
| 28L0138-70R | 1 FUNCTIONS, FERRITE BEAD |
| 28Z551 | TELECOM FILTER |
| 28Z550 | TELECOM FILTER |
相關代理商/技術參數 |
參數描述 |
|---|---|
| 28-22916 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 15S-60MIN |
| 28-22918 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 0.1-10 SEC |
| 28-22920 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD PRECISION TIMER 1-99 SEC |
| 28-22922 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD SEQUENTIAL TIMER 1SEC-3MIN |
| 28-22926 | 制造商:CEBEK 功能描述:PRE ASSEMBLED MODULE BOARD ON DELAY TIMER 1-60 SECOND |
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