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參數資料
| 型號： | W90100F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | Embedded Micro-Controller(32位嵌入式的微控制器) |
| 中文描述： | 嵌入式微控制器（32位嵌入式的微控制器） |
| 文件頁數： | 36/61頁 |
| 文件大小： | 380K |
| 代理商： | W90100F |
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W90100F
Embedded Micro-Controller
Revision 1.1
The above information is the exclusive intellectual property of Winbond Electronics Corp. and shall not be disclosed, distributed or reproduced without permission from Winbond
-36-
Publication Release Date: 10/07/97
8.5 Serial I/O (UART) Register Definition
Description
- Receiver Buffer Register.
- Read only.
- bit 7 is LSB.
- Transmitter Holding Register.
- Write only.
- bit 7 is LSB.
- Interrupt Enable Register.
0
3F8, DLAB = 0
RBR[0:7]
0
3F8, DLAB = 0
THR[0:7]
1
3F9, DLAB = 0
IER[3:7]
* bit 7: Irpt_RDA enable (1/0- Enable/Disable).
* bit 6: Irpt_THRE enable (1/0- Enable/Disable).
* bit 5: Irpt_RLS enable (1/0- Enable/Disable).
* bit 4: Irpt_MOS enable (1/0- Enable/Disable).
- bit 3: Loop-back enable (1/0- Enable/Disable).
* Divisor Latch Register (LS).
* Divisor Latch Register (MS).
- Interrupt Ident. Register.
- Read only.
0
1
2
3F8, DLAB = 1
3F9, DLAB = 1
3FA
DLL[0:7]
DLM[0:7]
IIR[0:7]
* bit 7: No Irpt pending (1/0- True/False).
* bit 6: Irpt ID bit (2).
* bit 5: Irpt ID bit (1).
* bit 4: Irpt ID bit (0).
- bit 3: DMA mode select (1/0- Mode 1/Mode 0).
- bit 2: RCVR trigger (LSB).
- bit 1: RCVR trigger (MSB).
- bit 0: FIFO mode enable (1/0- Enable/Disable).
- FIFO Control Register.
- Write only.
2
3FA
FCR[0:7]
* bit 7: FIFO mode enable (1/0- Enable/Disable).
- bit 6: Reset RCVR FIFO. (self_clearing bit)
- bit 5: Reset XMIT FIFO. (self_clearing bit)
- bit 4: DMA mode select (1/0- Mode 1/Mode 0).
- bit 3: (Reserve).
- bit 2: (Reserve).
* bit 1: RCVR trigger (LSB).
* bit 0: RCVR trigger (MSB).
- Line Control Register.
3
3FB
LCR[0:7]
* bit 7: Word length select (LSB).
* bit 6: Word length select (MSB).
- bit 5: Number of stop bit.
- bit 4: Parity enable. (1/0- Enable/Disable)
- bit 3: Even parity select. (1/0- Even/Odd parity)
- bit 2: Stick parity enable. (1/0- Enable/Disable)
- bit 1: Set break.
- bit 0: Divisor Latch Access Bit (DLAB).
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