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參數資料
| 型號： | W90100F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | Embedded Micro-Controller(32位嵌入式的微控制器) |
| 中文描述： | 嵌入式微控制器（32位嵌入式的微控制器） |
| 文件頁數： | 42/61頁 |
| 文件大小： | 380K |
| 代理商： | W90100F |
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W90100F
Embedded Micro-Controller
Revision 1.1
The above information is the exclusive intellectual property of Winbond Electronics Corp. and shall not be disclosed, distributed or reproduced without permission from Winbond
-42-
Publication Release Date: 10/07/97
8.6.2 Parallel Port Interface controller (peripheral side)
(base : 0x370)
---------------------------------------------------------------------------------------
: 8 : DL : - Data Lines. :
: : : - Read/Write. :
: : : - Exist only in BSTD mode. :
: : : :
: : : * bit [0:7] : Echo data line status. :
---------------------------------------------------------------------------------------
Note : 1. Reading DL returns the value on the data-line but not the value in the
data-register.
2. Writing DL drives the value directly into data-line.
---------------------------------------------------------------------------------------
: 9 : DSRA : - Device Status Register A. :
: : : - Read only. :
: : : :
: : : - bit 0 : Complement version of "nStrobe" pin. :
: : : - bit 1 : Complement version of "nAutoFd" pin. :
: : : - bit 2 : version of "nInit" pin. :
: : : - bit 3 : Complement version of "nSelectIn" pin. :
: : : - bit 4 : Device Fifo "full". (1/0 - True/False) :
: : : - bit 5 : Device Fifo "empty". (1/0 - True/False) :
: : : - bit [6:7] : reserved. :
---------------------------------------------------------------------------------------
: a : DCRA : - Device Control Register A. :
: : : - Read/Write. :
: : : :
: : : - bit [0:1] : reserved. :
: : : - bit 2 : Parallel Data port output enable. (1/0 - Enable/Disable) :
: : : - bit 3 : state driving to "nFault" pin. :
: : : - bit 4 : state driving to "Select" pin. :
: : : - bit 5 : state driving to "PError" pin. :
: : : - bit 6 : state driving to "nAck" pin. :
: : : - bit 7 : inverted state driving to "Busy" pin. :
---------------------------------------------------------------------------------------
Note : 1. The initial value of this register is 6'b1 which makes
Busy pin = nAck pin = low.
2. Bit 2 : This bit has no effect in EPP mode.
---------------------------------------------------------------------------------------
: b : DSRB : - Device Status Register B :
: : : - Read only. :
: : : :
: : : - bit [0:4] : reserved. :
: : : * bit [4:5] : Valid bytes in the Top PWord at the instanst of :
: : : reverse "abort operation". :
: : : * bit 6 : Device fifo over- or under-run. (1/0 - True/False) :
: : : * bit 7 : ECP/EPP Command register pended. (1/0 - True/False) :
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