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參數資料
| 型號： | W90100F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | Embedded Micro-Controller(32位嵌入式的微控制器) |
| 中文描述： | 嵌入式微控制器（32位嵌入式的微控制器） |
| 文件頁數： | 54/61頁 |
| 文件大?。?/td> | 380K |
| 代理商： | W90100F |
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W90100F
Printer Controller
Revision 1.1
The above information is the exclusive intellectual property of Winbond Electronics Corp. and shall not be disclosed, distributed or reproduced without permission from Winbond.
-54-
Publication Release Date: 10/07/97
8.9 Video Interface Command/Status Registers
8.9.1 Control Register IO1 (offset = 0300)
FSYNC_POL
0 (MSB)
FSYNC_ polarity control.
0: low active.
1: high active, or reverse the polarity of the FSYNC_ input.
FSYNC_ input/output control.
0: input.
1: output.
LSYNC_ polarity control.
0: no reverse
1: reverse the polarity of the LSYNC_ input.
CCLK_/SRDY_ select.
0: select CCLK_ for NEC or CANNON engine.
1: select SRDY_ for SHARP engine.
CBSY_ select.
0: CBSY_ output for NEC engine.
1: CBSY_ output for SHARP engine.
PRNT_ polarity control.
0: low active.
1: high active.
CMD/STS i/o signal direction control. When CMD/STS is
programmed as bidirectional I/O, the direction is controlled by
CBSY_ and SBSY_.
0: bidirectional I/O.
1: output.
CCLK_ command clock direction control.
0: bidirectional.
1: output.
1
FSYNC_SEL
2
LSYNC_POL
3
SRDY_SEL
4
CBSY_SEL
5
PRINT_POL
6
CMD_DIR
7(LSB)
CCLK_DIR
TABLE 8.20 VIDEO INTERFACE CONTROL REGISTER IO1
8.9.2 Control Register IO2 (offset = 0301)
reserved
reserved
reserved
reserved
reserved
reserved
CS_IEN
0(MSB)
1
2
3
4
5
6
CMD/STS completion interrupt enable bit.
0: disable.
1: enable.
Engine NOT ready interrupt enable bit.
0: disable.
1: enable.
7(LSB)
Eng_IEN
TABLE 8.21 VIDEO INTERFACE CONTROL REGISTER IO2
8.9.3 Engine Command Register (offset = 0304)
ECM
TABLE 8.22 ENGINE COMMAND REGISTER
0-7
Command to printer engine
8.9.4 Engine Status Register (offset = 0305)
EST
TABLE 8.23 ENGINE STATUS REGISTER
0-7
Status from printer engine
8.9.5 Control Register IO6 (offset = 0307)
reserved
0-3
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