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參數資料
| 型號： | W83877AF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | Multi-Function I/O Port Controller(多功能輸入／輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數： | 58/171頁 |
| 文件大小： | 1634K |
| 代理商： | W83877AF |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁當前第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁
W83877AF
Publication Release Date: Sep. 1996
Preliminary Version 0.50
- 56 -
4.3.2.3 Set0.Reg2 - Interrupt Status Register/UART FIFO Control Register (ISR/UFR)
(1) Interrupt Status Register: (Write Only)
Mode
B7
B6
B5
B4
B3
B2
B1
B0
Legacy
UART
FIFO
Enable
FIFO
Enable
0
0
IID2
IID1
IID0
IP
Advanced
UART
TMR_I
FSF_I
TXTH_I
DMA_I
HS_I
USR_I/
FEND_I
TXEMP_I
RXTH_I
Reset Value
0
0
1
0
0
0
1
0
Legacy UART:
Same as previous register defined.
Advanced UART:
Bit 7:
TMR_I - Timer Interrupt.
Set to 1 when timer count to 0. This bit will be affected by (1) the timer registers are
defined in Set4.Reg0 and Set4.Reg1, (2) EN_TMR(Enable Timer, in Set4.Reg2.Bit0)
should be set to 1, (3) ENTMR_I (Enable Timer Interrupt, in Set0.Reg1.Bit7) should be
set to 1.
MIR, FIR modes:
FSF_I - Frame Status FIFO Interrupt.
Set to 1 when Frame Status FIFO is equal or larger than the threshold level
or
Frame
Status FIFO time-out occurs. Clear to 0 when Frame Status FIFO is below the threshold
level.
Advanced UART/SIR/ASK-IR, Remote IR modes:
Not used.
TXTH_I - Transmitter Threshold Interrupt.
Set to 1 if the TBR (Transmitter Buffer Register) FIFO is below the threshold level. Clear
to 0 if the TBR (Transmitter Buffer Register) FIFO is below the threshold level.
MIR, FIR, Remote IR modes:
DMA_I - DMA Interrupt.
Set to 1 if the DMA controller 8237A sends a TC (Terminal Count) to I/O device which
that may be a Transmitter TC or a Receiver TC. Clear to 0 when this register is read.
HS_I - Handshake Status Interrupt.
Set to 1 when the Handshake Status Register has a toggle. Clear to 0 when Handshake
Status Register (HSR) is read. Note that in all IR modes included SIR, ASK-IR, MIR, FIR,
and Remote Control IR are defaulted to inactive except set IR Handshake Status Enable
(IRHS_EN) to 1.
Advanced UART/SIR/ASK-IR modes:
USR_I - UART Status Interrupt.
Set to 1 when overrun, or parity bit, or stop bit, or silent byte detected error in the UART
Status Register (USR) sets to 1. Clear to 0 when USR is read.
MIR, FIR modes:
Bit 6:
Bit 5:
Bit 4:
Bit 3:
Bit 2:
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