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參數(shù)資料
| 型號(hào)： | W83877AF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Multi-Function I/O Port Controller(多功能輸入／輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數(shù)： | 65/171頁 |
| 文件大小： | 1634K |
| 代理商： | W83877AF |
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W83877AF
Publication Release Date: Sep. 1996
Preliminary Version 0.50
- 63 -
4.3.3 Set1 - Legacy Baud Rate Divisor Register
Address
Offset
Register Name
Register Description
0
BLL
Baud Rate Divisor Latch (Low Byte)
1
BHL
Baud Rate Divisor Latch (High Byte)
2
ISR/UFR
Interrupt Status
or
UART FIFO Control Register
3
UCR/SSR
UART Control
or
Sets Select Register
4
HCR
Handshake Control Register
5
USR
UART Status Register
6
HSR
Handshake Status Register
7
UDR/ESCR
User Defined Register
4.3.3.1 Set1.Reg0~1 - Baud Rate Divisor Latch (BLL/BHL)
The two registers of BLL and BHL are baud rate divisor latch in the legacy UART/SIR/ASK-IR mode.
Read/Write these registers, if set in Advanced UART mode, will occur backward operation, that is, will
go to legacy UART mode and clear some register values shown table as follows.
Set & Register
Advanced Mode
DIS_BACK=
Legacy Mode
DIS_BACK=0
Set 0.Reg 4
Bit 7~5
-
Set 2.Reg 2
Bit 0, 5, 7
Bit 5, 7
Set 4.Reg 3
Bit 2, 3
-
Note that DIS_BACK=1 (Disable Backward operation) in legacy UART/SIR/ASK-IR mode will not
affect any register which that can operate legacy SIR/ASK-IR.
4.3.3.2 Set1.Reg 2~7
This registers is defined as same as Set 0 registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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