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參數資料
| 型號： | W83877AF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設及接口 |
| 英文描述： | Multi-Function I/O Port Controller(多功能輸入／輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數： | 64/171頁 |
| 文件大小： | 1634K |
| 代理商： | W83877AF |
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W83877AF
Publication Release Date: Sep. 1996
Preliminary Version 0.50
- 62 -
Bit 6
MIR, FIR modes:
UNDRN - Underrun
Set to 1 when transmitter is empty
and
not set S_FEND (in this register bit 3) operated in
PIO mode or not TC (Terminal Count) operated in DMA mode. Clear to 0 when write to 1.
MIR, FIR modes:
Bit 5
RX_BSY - Receiver Busy
Set to 1 when receiver is busy or active in process.
Remote IR mode:
RX_IP - Receiver in Process
Set to 1 when receiver is in process.
Bit 4:
MIR, FIR modes:
LST_FE - Lost Frame End
Set to 1 when a frame end in a entire frame is lost. Clear to 0 when read this register.
Remote IR modes:
RX_PD - Receiver Pulse Detected
Set to 1 when one or more than one remote pulses are detected. Clear to 0 when read
this register.
MIR, FIR modes:
Bit 3
S_FEND - Set a Frame End
Write to 1 when want to terminal the frame, that is, the procedure of PIO command is
An Entire Frame = Write Frame Data (First) + Write S_FEND (Last)
This bit should be set to 1, if use in PIO mode, to avoid transmitter underrun. Note that
this bit S_FEND is set to 1 that is equivalent to TC (Terminal Count) in DMA mode. So
that this bit should be set to 0 in DMA mode.
Reserved.
MIR, FIR modes:
Bit 2:
Bit 1:
LB_SF - Last Byte Stay in FIFO
Set to 1 that indicates one or more than one frame end still stay in receiver FIFO.
Bit 0:
MIR, FIR, Remote IR modes:
RX_TO - Receiver FIFO or Frame Status FIFO time-out
Set to 1 when receiver FIFO
or
frame status FIFO occurs time-out
相關PDF資料 |
PDF描述 |
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