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參數(shù)資料
| 型號： | W83877AF |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 外設(shè)及接口 |
| 英文描述： | Multi-Function I/O Port Controller(多功能輸入／輸出口控制器) |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封裝： | QFP-100 |
| 文件頁數(shù)： | 75/171頁 |
| 文件大小： | 1634K |
| 代理商： | W83877AF |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁當(dāng)前第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁
W83877AF
Publication Release Date: Sep. 1996
Preliminary Version 0.50
- 73 -
Bit 7:
FSFDR - Frame Status FIFO Data Ready
Indicated that have a valid data in frame status FIFO bottom.
Bit 6:
LST_FR - Lost Frame
Set to 1 when one or more than one frame has been lost.
Bit 5:
Bit 4:
Reserved
.
MX_LEX - Maximum Frame Length Exceed
Set to 1 when exceed programmed maximum frame length defined Set4.Reg6 and
Set4.Reg7. This bit is frame status FIFO bottom. To read this bit will return a valid value
when FSFDR=1 (Frame Status FIFO Data Ready).
Bit 3:
PHY_ERR - Physical Error
During receiving data, any physical layer error, defined IrDA 1.1, will be set to 1 in this bit.
This bit is frame status FIFO bottom. To read this bit will return a valid value when
FSFDR=1 (Frame Status FIFO Data Ready).
Bit 2:
CRC_ERR - CRC Error
Set to 1 when receive a bad CRC in a frame. This CRC belongs to physical layer defined in
IrDA 1.1. This bit is frame status FIFO bottom. To read this bit will return a valid value when
FSFDR=1 (Frame Status FIFO Data Ready).
Bit 1:
RX_OV - Received Data Overrun
Set to 1 when Received data in FIFO occur overrun.
Bit 0:
FSF_OV - Frame Status FIFO Overrun
Set to 1 When frame status FIFO occur overrun.
4.3.7.5 Set5.Reg6, 7 - Receiver Frame Length FIFO (RFLFL/RFLFH) or Lost Frame Number
(LST_NU)
Reg.
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
RFLFL/
LST_NU
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Reset Value
0
0
0
0
0
0
0
0
RFLFH
-
-
-
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Reset Value
0
0
0
0
0
0
0
0
Receiver Frame Length FIFO (RFLFL/RFLFH):
These registers are 13-bit. Read these registers will return received frame length. When read the
register of
RFLFH
will pop-up another frame status and frame length if FSFDR=1 (Set5.Reg4.Bit7).
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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