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參數資料
| 型號： | W88227QD |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-ROM Decoder(支持ATAPI標準的CD-ROM解碼器) |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數： | 62/116頁 |
| 文件大小： | 787K |
| 代理商： | W88227QD |
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Preliminary/Confidential
Subject to change without notice
W88227F/W88227QD
- 58 -
1999/10/1 Rev: 0.70
HICTL0 - Host Interface Control Register - (write 1Fh)
Bit 7-6: reserved
Bit 5:
H16S - (obsolete)
No matter what value is set, the data transfer between host and decoder is using 16-bit protocol.
Bit 4:
LAEN - Latch Enable
If this bit is high, host address and chip-select signals will be latched when pins nHRD or
nHWR change from high to low.
Bit 3:
MDMA - Multi-word DMA mode
Setting this bit to high enables multi-word DMA mode if
PIO (1Fh.2)
is low.
PIO - PIO/DMA mode select
Bit 2:
Setting this bit high causes data transfer to/from host using PIO mode. This bit is also controlled by
bit-0 of ATFEA (1F1h/171h) if
ASMDA (5Bh.7)
is high.
DINB - Data-In Transfer Enable
Bit 1:
Setting this bit low select data-in transfer. Otherwise, the data-out transfer is enabled.
Bit 0:
UDMA - Ultra DMA Enable
Setting this bit high selects data transfer protocol as Ultra DMA. The bandwidth of Ultra DMA
depends on the system frequency and the setting of
UDT1-0 (8Ah.5-4)
.
HICTL0 (1Fh,w)
data-in
data-out
PIO mode
xxxx x10xb
xxxx x11xb
MDMA mode
x8h
xAh
UDMA mode
x9h
xBh
STAT5 - Status Register 5 - (read 1Fh)
Bit 7:
UTBY - Microprocessor to RAM Transfer Busy
When the microprocessor-to-RAM transfer is not complete, this bit is high.
Bit 6-4: Reserved
Bit 3:
MDMA - Multi-word DMA mode
Bit 2:
Bit 1:
Bit 0:
PIO - PIO/DMA mode select
DINB - Data-In Transfer Enable
UDMA - Ultra DMA Enable
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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