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參數資料
| 型號： | W88227QD |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-ROM Decoder(支持ATAPI標準的CD-ROM解碼器) |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP128 |
| 封裝： | LQFP-128 |
| 文件頁數： | 69/116頁 |
| 文件大小： | 787K |
| 代理商： | W88227QD |
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Preliminary/Confidential
Subject to change without notice
W88227F/W88227QD
- 65 -
1999/10/1 Rev: 0.70
Bit 3 : HIRQ - Host Interrupt Request
Set this bit high asserts interrupt at pin HIRQ if the drive is selected and nIEN is enabled in the
ATAPI Device Control Register. HIRQ is also automatically set by the following:
Automatic Packet Transfer sequence, enabled by
APKTEN (18h.7)
Automatic Status Completion sequence, enabled by
SCT (17h.w0)
or
ASCEN (18h.5)
HIRQ is automatically de-activated by the following:
Master reset
Set bit SRST in the ATAPI Device Control Register high
Host issue ATA command while the drive is selected
Host read ATAPI Status Register while the drive is selected
SHIEN - Shadow Command Interrupt Enable
Bit 2:
Setting this bit high enables the microprocessor interrupt for the shadow command. Signal
UINTb
becomes low-active when
SHDC (2Fh.r5)
becomes high-active if this bit is enabled.
Bit 1, 0: Reserved
MISS0 - Miscellaneous Status Register 0 - (read 2Eh)
Bit 5:
SRUb - Status Register Updated Flag
This bit becomes high when the ATAPI Status Register is updated by the following:
Microprocessor writes to 37h
Microprocessor triggers
DSCT (17h.w5)
Microprocessor triggers
SCT (17h.w0)
Automatic Status Completion occurs if
ASCEN (18h.5)
is enabled
Reception of A0h command if
APKTEN (18h.7)
is enabled
Master reset
MDRVF - Master Drive Flag
Bit 4:
This bit is high if the drive is configured as Master. This bit is low if the drive is configured as Slave.
Bit 3:
HINTF - Host Interrupt Flag
This bit reflects the status of the source of
pin HIRQ
.
Bit 2:
nIEN - Bit nIEN in Device Control Register
This bit reflects the value of bit nIEN in ATAPI Device Control Register.
Bit 1:
NPDIAG - Pin NPDIAG Flag
This bit reflects the status of
pin NPDIAG.
NDASP - Pin NDASP Flag
Bit 0:
This bit reflects the status of
pin NDASP.
相關PDF資料 |
PDF描述 |
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參數描述 |
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