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參數資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結構的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結構的32位嵌入式微控制器） |
| 文件頁數： | 111/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
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=
The above information is the exclusive intellectual property of Winbond Electronics and shall not be disclosed, distributed or reproduced without permission from Winbond.
111
Versi on 0. 4, March/2000
Bit 7
Dfifo over/under run
0 = Dfifo is not yet over- or under-run
1 = Dfifo is already over- or under-run
Once this bit is set, it will keep on set state until Dfifo or the PPI is reset.
FIFO Control Register (FCR)
Port address : 0xf000037c
Read/Write
Power-on Default : 0x0
0
1
2
3
4
5
6
7
DMAen
FRST
DRST
PWord
MOD
RDTH
Bits 0 DMA mode enable
A low-to-high transition of this bit will make PPI issue a DREQ to DMA controller.
On receiving the corresponding DACK, PPI deasserts the DREQ.
This bit will be cleared by DMA terminal-count (TC) asserting or by a CPU write
cycle with data-in[0] = 0.
Bit 1
Reset Dfifo
Writing a logical one to this bit will assert "Dfifo Reset" for one EXTCLK cycle.
This bit will return to deasserted state automatically after "Dfifo Reset" is issued.
Bit 2
Reset Device
Writing a logical one to this bit will assert "Device Reset" for one EXTCLK cycle.
This bit will return to deasserted state automatically after "Device Reset" is issued.
Bit 3
PWord size
0 = PWord is 8 bits (1 byte)
1 = PWord is 32 bits (4 bytes)
"PWord" defines the basic unit of Dfifo access during CPU cycle.
Bit 4-5 Device mode select
IER[1] and FCR[4:5] are used to choose device operation mode.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
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