- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄363904 > W90221F (WINBOND ELECTRONICS CORP) PA-RISC Embedded Micro-Controller(惠普PA-RISC結(jié)構(gòu)的32位嵌入式微控制器) PDF資料下載
參數(shù)資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結(jié)構(gòu)的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結(jié)構(gòu)的32位嵌入式微控制器） |
| 文件頁數(shù)： | 142/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
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=
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142
Versi on 0. 4, March/2000
by non-
automatically. (ie,
relative base
- bit 27-29
- bit 30
- bit 31
AIR[4]
- bit 0-15
- bit 16-31
AIR[5]
AIR[6]
AIR[7]
Back up states of PSW as pipeline enter HALT state.
AIR[8]
: (ICEA_Front, ICEA_Back)
Back up IAOQ_Frond and IAOQ_Back as pipeline enter HALT state
AIR[9]
: (IDR[0:31]) ICE-Data register
This register is used for data exchange between ICE module and CPU.
AIR[10] : (ITR[0:31]) ICE-Trap register
This register defines which trap event would force pipeline enter HALT state.
AIR[11] : (PWR[0:2]) Power-Mode register
- bit 0
: (SLEEP) Force CPU into sleep mode
- bit 1
: (DOZE) Force CPU to doze-mode
- bit 2
: (STDBY) Force CPU to stand-by-mode
AIR[12] : (CKR[0:7]) Stand-By-Clock register
Define the clock rate (STDCLK) in Stand-By mode :
STDCLK = CPUCLK /((CKR[0:7]+1)*4)
The bit definition is the same as that of bit 21-23. The base address, defined
cacheable base register (AIR[4]), will be on each regions' boundary
according to the size of each non-cacheable region, some LSBs of their
register will be neglected.
: reserved
: Data cache write-through mode
0 : write-back data cache
1 : write-through data cache
: reserved
: NonCacheable Base register
(default : 32'b0)
: base address of non-cacheable region 1
: base address of non-cacheable region 2
: reserved
: reserved
: (HPSW[0:31])
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