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參數資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結構的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結構的32位嵌入式微控制器） |
| 文件頁數： | 121/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
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=
The above information is the exclusive intellectual property of Winbond Electronics and shall not be disclosed, distributed or reproduced without permission from Winbond.
121
Versi on 0. 4, March/2000
0 0 0 0
Fourth
MODEM
Status
(Irpt_MOS)
CTS, DSR, DCD
bits chang state or
RI bit changes from
high to low
Reading the MSR
FIFO Control Register (FCR)
Port address : 0xf00003fa (COM0)
0xf00002fa (COM1)
Write only
Power-on Default : 0x1
0
1
2
3
4
5
6
7
RTH[0:1]
Reserved
DMOD
TXRST
RXRST
FMEN
Bits 0-1 RX FIFO interrupt (Irpt_RDA) trigger level
FCR[0:1]
0 0
0 1
1 0
1 1
Irpt_RDA trigger level (bytes)
01
04
08
14
Bit 4
Bit 5
Bit 6
Bit 7
DMA mode select
The DMA function is
not implemented
in this version.
Reset TX FIFO
Seting this bit will generate 1 OSC cycle reset pulse to reset TX FIFO. The TX FIFO
becomes empty (TX-pointer is cleared to 0) after such reset. This bit is returned to 0
automatically after the reset pulse is generated.
Reset RX FIFO
Seting this bit will generate 1 OSC cycle reset pulse to reset RX FIFO. The RX FIFO
becomes empty (RX-pointer is cleared to 0) after such reset. This bit is returned to 0
automatically after the reset pulse is generated.
FIFO mode enable
The UART0 and UART1 are always operated on FIFO mode. Writing this bit has no
effect while reading this bit always get logical one.
Line Control Register (LCR)
相關PDF資料 |
PDF描述 |
|---|---|
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