- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄363904 > W90221F (WINBOND ELECTRONICS CORP) PA-RISC Embedded Micro-Controller(惠普PA-RISC結(jié)構(gòu)的32位嵌入式微控制器) PDF資料下載
參數(shù)資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結(jié)構(gòu)的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結(jié)構(gòu)的32位嵌入式微控制器） |
| 文件頁數(shù)： | 50/174頁 |
| 文件大?。?/td> | 2102K |
| 代理商： | W90221F |
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=
The above information is the exclusive intellectual property of Winbond Electronics and shall not be disclosed, distributed or reproduced without permission from Winbond.
50
Versi on 0. 4, March/2000
Bit 3 SDRAM RESET end select
This bit reserved for simulation only.
Bit 4 SDRAM precharge set
This bit set will issue a precharge command to SDRAM.
Bit 5 SDRAM mode register set
This bit set will issue a mode register set command to SDRAM.
Bit 6
SDRAM refresh cycle enable
This bit set will issue a refresh command to SDRAM.
Bit 7
SDRAM clock enable
0 = disable
1 = enable
Bit 8
Swap out 0xA0000 ~ 0xFFFFF
When this bit is set to a logic 1, address space 0xA0000 ~ 0xFFFFF will not be recognized as
"system" DRAM space.
Bit 9-11 DRAM controller control signal clock skew adjustment reference CLKTREE MCLKo.
Bit 9-11
MCLK ctrl delay
(xo02d2 delay)
0
2
4
6
8
10
12
14
0 0 0
0 0 1
0 1 0
0 1 1
1 0 0
1 0 1
1 1 0
1 1 1
Bit 12-14 DRAM controller data latch clock skew adjustment reference external MCLK.
Bit 12-14
MCLK data delay
(xo02d2 delay)
0
2
4
0 0 0
0 0 1
0 1 0
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