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參數資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結構的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結構的32位嵌入式微控制器） |
| 文件頁數： | 164/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁當前第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁
=
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164
Versi on 0. 4, March/2000
switch(cmplt){
case r: (r=1, rounding mode){
GR[t]{0:31}
←
({HI, LO} - (lshift(sign_ext(GR[r1]{0:15}) * sign_ext(GR[r2]{0:15}),
1) + 16h8000)){32:63};
{HI, LO}
←
({HI, LO} - (lshift(sign_ext(GR[r1]{0:15}) *
sign_ext(GR[r2]{0:15}),
1) + 16h8000)){0:63};
break;
}
default : (r=0, unrounding mode){
GR[t]{0:31}
←
({HI, LO} - (lshift(sign_ext(GR[r1]{0:15}) * sign_ext(GR[r2]{0:15}),
1){32:63};
{HI, LO}
←
({HI, LO} - (lshift(sign_ext(GR[r1]{0:15}) *
sign_ext(GR[r2]{0:15}),
1){0:63};
break;
}
}
Exception :
None
Halfword Multiply And Subtract Unsign
Format:
HMSBU, cmplt
r1,r2,t
0:5 6:10 11:15 16:18 19 20
21:25 26 27:31
05
r2
r1
~
r
1
04
6 5 5 3 1
1 5 1 5
Purpose:
To multiply two unsigned 16-bit halfword of GR[r1] and GR[r2] , then subtract the
multiplied result from {HI, LO} accumulate register..
Description:
The corresponding 16-bit halfwords of GR[r1] and GR[r2] are interpretted as
unsigned 16-bit operands, and are arithmetically multiplied, then subtract the product from the
present contents of the {HI, LO} register, the 64-bit result is placed in {HI, LO} register and GR[t],
the bit in AIR[25] which indicates operating in integer or fraction mode determines the high-order
halfword or low-order halfword of GR[r1], GR[r2] will be as the two operands .
The completer
"
r
"
indicates operating in rounding mode, the multiply result can be
truncated the lower 16 bits when the least 16th bit is zero. IF the the least 16th bit is one, add
one the high-order 16 bits and truncate the low-order 16 bits.
Operation:
Integer mode operation (AIR[25] = 0) :
switch (cmplt) {
HMSBU
~
t
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