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參數資料
| 型號： | W90221F |
| 廠商： | WINBOND ELECTRONICS CORP |
| 英文描述： | PA-RISC Embedded Micro-Controller(惠普PA-RISC結構的32位嵌入式微控制器) |
| 中文描述： | PA - RISC的嵌入式微控制器（惠普的PA - RISC結構的32位嵌入式微控制器） |
| 文件頁數： | 120/174頁 |
| 文件大小： | 2102K |
| 代理商： | W90221F |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁當前第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁
=
The above information is the exclusive intellectual property of Winbond Electronics and shall not be disclosed, distributed or reproduced without permission from Winbond.
120
Versi on 0. 4, March/2000
0xf00002fa (COM1)
0
1
2
3
4
5
6
7
FMENo
RTHo[0:1]
DMOD
IID[0:2]
NOI
Bits 0 Status of "FIFO Mode Enable"
This bit echos if "FIFO mode" is enable or not. Since "FIFO mode" is always enable,
this bit always shows logical 1 when CPU reading this register.
Bit 1-2 Status of RX FIFO threshold level
These bits show current setting of receiver FIFO threshold level (RTH). The meaning of
RTH is defined in the following FCR description.
Bit 3
DMA mode select
The DMA function is
not implemented
in this version. Reading IIR, the bit-3 is always 0.
Bit 4-6 Interrupt Identification bits
The IID[0:2] along with NOI indicate current interrupt request from COM port
Bit 7
No Interrupt (NOI) pended
Table 6.7-3 : Interrupt Control Functions
IIR[4:7]
Priority
Interrupt Type
Interrupt Source
Interrupt Reset
control
--
- - -
1
0 1 1 0
--
None
None
Highest
Receiver Line
Status
(Irpt_RLS)
Overrun Error or
Parity Error or
Framing Error or
Break Interrupt
Receiver FIFO
thres-hold level is
reached
Receiver FIFO is
non-empty and no
activities are
occured in receiver
FIFO during the
TOR defined time
duration
Transmitter Holding
Register Empty
Reading the LSR
0 1 0 0
Second
Received Data
Available
(Irpt_RDA)
Receiver FIFO
Time-out
(Irpt_TOUT)
Receiver FIFO
drops below the
threshold level
Reading the RBR
1 1 0 0
Second
0 0 1 0
Third
Transmitter
Hoding
Register
Empty
(Irpt_THRE)
Reading the IIR (if
source of interrupt
is Irpt_THRE) or
writing into the THR
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